AMDの技術者が初期のZen 3 / Milanアーキテクチャの詳細とZen 4 /Genoa計画を明かす

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215: Socket774 (ササクッテロル Spbd-/trd) 2019/10/05(土) 12:59:11.44 ID:CoH4WkqDp

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AMD reveals early Zen 3/Milan architecture details and Zen 4/Genoa plans
――――  以下、Google翻訳  ――――
2019年9月16/17日に開催されたHPC AI Advisory Councilの2019 UK Conferenceで、AMDのMartin Hilgemanは、AMDの次世代Zen 3 Milanアーキテクチャと同社が計画しているZen 4 / Genoaアーキテクチャに関する初期の詳細を明らかにしました。

AMDのプレゼンテーションで、HPCアプリケーションのシニアマネージャーであるAMDのMartin Hilgemanは、AMDの今後の「ミラノ」シリーズのZen 3プロセッサがAMDの既存のSP3サーバーソケットでリリースされ、DDR4メモリをサポートし、同じTDPとコアカウントを提供することを確認するスライドを公開しました。

このスライドは、AMDがミラノを4倍のSMT実装でリリースすることを計画したという噂を払拭しているように見えます。Zen 3のパフォーマンス向上の主な原因は、コア/スレッド数の増加ではなく、IPCの強化とクロック速度の向上にあるようです。願わくば、これはZen 3がシングルスレッドのパフォーマンスとコアアーキテクチャの改善に集中することを意味します。

Zen 4 / Genoaに移ると、HelgemanはZen 4がまだ設計段階にあると述べています。つまり、サーバーメーカーや他の顧客がGenoaの設計に影響を与える機会があるということです。また、Zen 4 / Genoaが新しいSP5ソケットでリリースされ、新しいメモリタイプ(おそらくDDR5)をサポートし、ユーザーに「新しい機能」を提供することも確認されています。

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Zen 3
プレゼンテーションの途中で、AMDのMartin Hilgemanは、Zen 3がZen / Zen 2のスプリットキャッシュデザインから離れ、AMDのCPUダイ上のL3キャッシュを2つのクアッドコアCCXに分割することを確認しました。これは、AMDがクアッドコアCCXデザインから脱却し、Zen 3で8コアCCXデザインを作成するか、異なるデザインスキームを使用するCPUデザインを作成できることを意味します。

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AMDの現在のZen 2設計で見られるように、サイズが16MBの2つのL3キャッシュを提供する代わりに、AMDのZen 3コア設計は、8つすべてのCPUコア間に「32 + MB」のL3キャッシュを組み合わせて提供します。これにより、単一ダイのCPUコア間の潜在的なCCX間レイテンシが低下し、CPUコアが各チップのオンボードL3キャッシュメモリにアクセスしやすくなります。

下のスライドは、Zen 3のL3キャッシュがZen 2で見られるものよりも大きくなることも示唆しています。これは、Zen 3がより大きなL3キャッシュを組み合わせて提供できることを意味します。容量。これにより、一部の内部CPUレイテンシが低下し、Zen 3プロセッサがダイ上により多くのデータをキャッシュできるようになります。AMDの「GameCache」の既存のマーケティングとZen 2のメリットを考えると、これらの変更はZen 3のゲームパフォーマンスにとって有益です。

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これらのスライドに基づいて、Zen 3はAMDのZen CPUアーキテクチャのもう1つの主要な設計変更を示し、プロセッサの内部キャッシュレイテンシに非常に有益な変更を提供します。AMDのZen 3コア設計についてはほとんど知られていませんが、これらのスライドは、AMDの次世代アーキテクチャが、AMDの既存の設計の欠点をさらに軽減することを目指していることを示しています。これらの欠点は、Zen 2によってすでに大幅に削減されましたが、Zen 3は物事を別のレベルに引き上げようとしています。

https://www.overclock3d.net/news/cpu_mainboard/amd_reveals_early_zen_3_milan_architecture_details_and_zen_4_genoa_plans/1

93: Socket774 2019/10/05(土) 12:59:06.56 ID:ZjoUP5rZ
他コア化が一層進みそう
これは8コアAPUも期待して良いのかね


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Source: 汎用型自作PCまとめ

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